图书介绍
Verilog HDL数字系统设计pdf电子书版本下载
- 王建民，田晓华，江晓林编著 著
- 出版社： 哈尔滨：哈尔滨工业大学出版社
- ISBN：9787560331690
- 出版时间：2011
- 标注页数：357页
- 文件大小：14MB
- 文件页数：369页
- 主题词：硬件描述语言，Verilog HDL－程序设计
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图书目录
第1章 数字系统设计概述 1
1.1 引言 1
1.2 ASIC和FPGA 2
1.3 数字设计的层次 3
1.4 硬件描述语言 5
1.5 典型设计流程 7
本章小结 8
习题与思考题1 8
第2章 组合逻辑电路设计回顾 9
2.1 数字电路的基本概念 9
2.2 布尔代数和逻辑门 10
2.3 逻辑函数的化简 14
2.4 组合逻辑电路的设计方法 18
2.5 若干常用组合逻辑电路 19
本章小结 28
习题与思考题2 28
第3章 时序逻辑设计回顾 29
3.1 时序逻辑电路 29
3.2 基本存储元件 30
3.3 时序逻辑电路的分析 35
3.4 时序逻辑电路的设计 38
3.5 若干常用的时序逻辑电路 41
本章小结 47
习题与思考题3 47
第4章 Verilog硬件描述语言 49
4.1 引言 49
4.2 第1个Verilog HDL实例 49
4.3 基本词法规定 50
4.4 数据类型 52
4.5 程序框架 55
4.6 结构级描述 57
4.7 门级描述 60
4.8 Tesbench 64
本章小结 66
习题与思考题4 66
第5章 组合逻辑电路 68
5.1 引言 68
5.2 连续赋值语句 68
5.3 Verilog HDL操作符 70
5.4 组合逻辑always块 73
5.5 If语句 76
5.6 case语句 83
5.7 条件语句的综合 86
5.8 可重用设计 89
5.9 组合逻辑电路设计实例 93
5.10 高效的HDL描述 109
5.11 组合逻辑电路设计要点 129
本章小结 133
习题与思考题5 133
第6章 基本时序逻辑电路 135
6.1 引言 135
6.2 时序逻辑电路 135
6.3 同步时序逻辑电路 138
6.4 基于原语的时序电路设计 140
6.5 基本存储元件的Verilog HDL实现 142
6.6 设计实例 146
6.7 时序逻辑电路的Testbench 159
6.8 时序逻辑电路设计要点 162
本章小结 170
习题与思考题6 171
第7章 同步时序逻辑电路的时序分析 172
7.1 引言 172
7.2 Verilog HDL的抽象层次 172
7.3 同步时序电路的时序分析方法 174
7.4 组合逻辑的传播延迟 177
7.5 时序逻辑电路的传播延迟 179
7.6 提高电路的最高工作频率 184
7.7 提高电路的建立时间和保持时间 187
本章小结 188
习题与思考题7 188
第8章 有限状态机 190
8.1 引言 190
8.2 有限状态机 190
8.3 米利状态机和摩尔状态机 191
8.4 状态转换图和算法状态机图 196
8.5 有限状态机的性能和时序 201
8.6 状态赋值 203
8.7 FSM的Verilog HDL实现 208
8.8 输出缓冲器 222
8.9 设计实例 229
本章小结 237
习题与思考题8 237
第9章 数据通道（FSMD） 239
9.1 引言 239
9.2 寄存器传输级设计 240
9.3 FSMD设计原理 242
9.4 FSMD设计方法和步骤 245
9.5 流水线设计 259
9.6 FSMD设计实例 273
本章小结 279
习题与思考题9 279
第10章 FSMD设计实践 281
10.1 引言 281
10.2 定点数的表示及饱和算术运算 281
10.3 混合方程 284
10.4 混合方程的直接实现 286
10.5 输入寄存器和输出寄存器 290
10.6 流水线设计和流水线执行单元 291
10.7 资源共享数据通道的设计 295
10.8 带有握手信号的数据通道 299
10.9 具有输入总线的数据通道 302
10.10 递归计算、初始化和计算 307
10.11 复杂数据通道的设计方法 311
10.12 寄存器的Schedule 314
10.13 数据流图的等价变形 320
本章小结 321
习题与思考题10 321
第11章 SPI主机接口设计 322
11.1 引言 322
11.2 SPI总线标准 322
11.3 SPI主机功能描述 324
11.4 微控制器接口模块 327
11.5 SPI主机接口模块 337
本章小结 356
习题与思考题11 356
参考文献 357